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Commit b4732f06 authored by Marek Vasut's avatar Marek Vasut
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rcar_gen3: drivers: pfc: V3M: Switch to BIT() macro 



Utilise existing BIT() macro. No functional change.
Signed-off-by: default avatarMarek Vasut <marek.vasut+renesas@gmail.com>
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drivers/staging/renesas/rcar/pfc/V3M/pfc_init_v3m.c
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...@@ -13,116 +13,116 @@ ...@@ -13,116 +13,116 @@
#include "../pfc_regs.h" #include "../pfc_regs.h"
/* Pin functon bit */ /* Pin functon bit */
#define GPSR0_DU_EXODDF_DU_ODDF_DISP_CDE ((uint32_t)1U << 21U) #define GPSR0_DU_EXODDF_DU_ODDF_DISP_CDE BIT(21)
#define GPSR0_DU_EXVSYNC_DU_VSYNC ((uint32_t)1U << 20U) #define GPSR0_DU_EXVSYNC_DU_VSYNC BIT(20)
#define GPSR0_DU_EXHSYNC_DU_HSYNC ((uint32_t)1U << 19U) #define GPSR0_DU_EXHSYNC_DU_HSYNC BIT(19)
#define GPSR0_DU_DOTCLKOUT ((uint32_t)1U << 18U) #define GPSR0_DU_DOTCLKOUT BIT(18)
#define GPSR0_DU_DB7 ((uint32_t)1U << 17U) #define GPSR0_DU_DB7 BIT(17)
#define GPSR0_DU_DB6 ((uint32_t)1U << 16U) #define GPSR0_DU_DB6 BIT(16)
#define GPSR0_DU_DB5 ((uint32_t)1U << 15U) #define GPSR0_DU_DB5 BIT(15)
#define GPSR0_DU_DB4 ((uint32_t)1U << 14U) #define GPSR0_DU_DB4 BIT(14)
#define GPSR0_DU_DB3 ((uint32_t)1U << 13U) #define GPSR0_DU_DB3 BIT(13)
#define GPSR0_DU_DB2 ((uint32_t)1U << 12U) #define GPSR0_DU_DB2 BIT(12)
#define GPSR0_DU_DG7 ((uint32_t)1U << 11U) #define GPSR0_DU_DG7 BIT(11)
#define GPSR0_DU_DG6 ((uint32_t)1U << 10U) #define GPSR0_DU_DG6 BIT(10)
#define GPSR0_DU_DG5 ((uint32_t)1U << 9U) #define GPSR0_DU_DG5 BIT(9)
#define GPSR0_DU_DG4 ((uint32_t)1U << 8U) #define GPSR0_DU_DG4 BIT(8)
#define GPSR0_DU_DG3 ((uint32_t)1U << 7U) #define GPSR0_DU_DG3 BIT(7)
#define GPSR0_DU_DG2 ((uint32_t)1U << 6U) #define GPSR0_DU_DG2 BIT(6)
#define GPSR0_DU_DR7 ((uint32_t)1U << 5U) #define GPSR0_DU_DR7 BIT(5)
#define GPSR0_DU_DR6 ((uint32_t)1U << 4U) #define GPSR0_DU_DR6 BIT(4)
#define GPSR0_DU_DR5 ((uint32_t)1U << 3U) #define GPSR0_DU_DR5 BIT(3)
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#define GPSR0_DU_DR3 ((uint32_t)1U << 1U) #define GPSR0_DU_DR3 BIT(1)
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...@@ -133,314 +133,314 @@ ...@@ -133,314 +133,314 @@
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#define IOCTRL31_POC_VI1_HSYNC_N ((uint32_t)1U << 9U) #define IOCTRL31_POC_VI1_HSYNC_N BIT(9)
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#define IOCTRL31_POC_VI0_DATA10 ((uint32_t)1U << 4U) #define IOCTRL31_POC_VI0_DATA10 BIT(4)
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/* SCIF3 Registers for Dummy write */ /* SCIF3 Registers for Dummy write */
#define SCIF3_BASE (0xE6C50000U) #define SCIF3_BASE (0xE6C50000U)
...@@ -502,7 +502,7 @@ static void StartRtDma0_Descriptor(void) ...@@ -502,7 +502,7 @@ static void StartRtDma0_Descriptor(void)
} }
/* Initialize ch0, Reset Descriptor */ /* Initialize ch0, Reset Descriptor */
mmio_write_32(RTDMAC_RDMCHCLR, ((uint32_t)1U << RTDMAC_CH)); mmio_write_32(RTDMAC_RDMCHCLR, BIT(RTDMAC_CH));
mmio_write_32(RTDMAC_RDMCHCRB(RTDMAC_CH), RDMCHCRB_DRST); mmio_write_32(RTDMAC_RDMCHCRB(RTDMAC_CH), RDMCHCRB_DRST);
/* Enable DMA */ /* Enable DMA */
......
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